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arch/tile: use interrupt critical sections less
authorChris Metcalf <cmetcalf@tilera.com>
Tue, 27 Mar 2012 19:40:20 +0000 (15:40 -0400)
committerChris Metcalf <cmetcalf@tilera.com>
Fri, 25 May 2012 16:48:20 +0000 (12:48 -0400)
commit51007004f44c9588d70ffb77e1f52479bd5b0e37
treeddf8dd2f83554ecbe9de0c690cfab3889308397b
parent76e10d158efb6d4516018846f60c2ab5501900bc
arch/tile: use interrupt critical sections less

In general we want to avoid ever touching memory while within an
interrupt critical section, since the page fault path goes through
a different path from the hypervisor when in an interrupt critical
section, and we carefully decided with tilegx that we didn't need
to support this path in the kernel.  (On tilepro we did implement
that path as part of supporting atomic instructions in software.)

In practice we always need to touch the kernel stack, since that's
where we store the interrupt state before releasing the critical
section, but this change cleans up a few things.  The IRQ_ENABLE
macro is split up so that when we want to enable interrupts in a
deferred way (e.g. for cpu_idle or for interrupt return) we can
read the per-cpu enable mask before entering the critical section.
The cache-migration code is changed to use interrupt masking instead
of interrupt critical sections.  And, the interrupt-entry code is
changed so that we defer loading "tp" from per-cpu data until after
we have released the interrupt critical section.

Signed-off-by: Chris Metcalf <cmetcalf@tilera.com>
arch/tile/include/asm/irqflags.h
arch/tile/kernel/entry.S
arch/tile/kernel/intvec_64.S
arch/tile/mm/init.c
arch/tile/mm/migrate.h
arch/tile/mm/migrate_32.S
arch/tile/mm/migrate_64.S