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crypto: caam - enable LARGE_BURST for enhancing DMA transactions size
authorHoria Geant? <horia.geanta@nxp.com>
Tue, 12 Jan 2016 15:14:10 +0000 (17:14 +0200)
committerHerbert Xu <herbert@gondor.apana.org.au>
Mon, 25 Jan 2016 14:39:03 +0000 (22:39 +0800)
Increasing CAAM DMA engine transaction size either
-reduces the number of required transactions or
-adds the ability to transfer more data with same transaction count

Signed-off-by: Horia Geant? <horia.geanta@nxp.com>
Signed-off-by: Herbert Xu <herbert@gondor.apana.org.au>
drivers/crypto/caam/ctrl.c
drivers/crypto/caam/regs.h

index 69d4a1326feefa6ff4c404d7e093a658728f6f4a..44d30b45f3cc35a44ee692bc6b48706e819b760c 100644 (file)
@@ -534,7 +534,7 @@ static int caam_probe(struct platform_device *pdev)
         * long pointers in master configuration register
         */
        clrsetbits_32(&ctrl->mcr, MCFGR_AWCACHE_MASK, MCFGR_AWCACHE_CACH |
-                     MCFGR_AWCACHE_BUFF | MCFGR_WDENABLE |
+                     MCFGR_AWCACHE_BUFF | MCFGR_WDENABLE | MCFGR_LARGE_BURST |
                      (sizeof(dma_addr_t) == sizeof(u64) ? MCFGR_LONG_PTR : 0));
 
        /*
index a8a79975682f2c5096e1beccd1c71714530a7176..0ba9c40597dcbbf75163bedb5f4e7ef0f1b46972 100644 (file)
@@ -455,7 +455,8 @@ struct caam_ctrl {
 #define MCFGR_AXIPIPE_MASK     (0xf << MCFGR_AXIPIPE_SHIFT)
 
 #define MCFGR_AXIPRI           0x00000008 /* Assert AXI priority sideband */
-#define MCFGR_BURST_64         0x00000001 /* Max burst size */
+#define MCFGR_LARGE_BURST      0x00000004 /* 128/256-byte burst size */
+#define MCFGR_BURST_64         0x00000001 /* 64-byte burst size */
 
 /* JRSTART register offsets */
 #define JRSTART_JR0_START       0x00000001 /* Start Job ring 0 */