]> git.proxmox.com Git - mirror_edk2.git/blob - Vlv2TbltDevicePkg/PlatformInitPei/PlatformEarlyInit.h
projects / mirror_edk2.git / blob
? search:
summary | shortlog | log | commit | commitdiff | tree
blame | history | raw | HEAD
ArmVirtPkg/ArmVirtXen: don't set PcdShellFile
[mirror_edk2.git] / Vlv2TbltDevicePkg / PlatformInitPei / PlatformEarlyInit.h
1 /*++
2
3 Copyright (c) 2004 - 2016, Intel Corporation. All rights reserved.<BR>
4
5 This program and the accompanying materials are licensed and made available under
6 the terms and conditions of the BSD License that accompanies this distribution.
7 The full text of the license may be found at
8 http://opensource.org/licenses/bsd-license.php.
9
10 THE PROGRAM IS DISTRIBUTED UNDER THE BSD LICENSE ON AN "AS IS" BASIS,
11 WITHOUT WARRANTIES OR REPRESENTATIONS OF ANY KIND, EITHER EXPRESS OR IMPLIED.
12
13
14 Module Name:
15
16 PlatformEarlyInit.h
17
18 Abstract:
19
20 Platform Early Stage header file
21
22
23
24 --*/
25
26 /*++
27 This file contains an 'Intel Peripheral Driver' and is
28 licensed for Intel CPUs and chipsets under the terms of your
29 license agreement with Intel or your vendor. This file may
30 be modified by the user, subject to additional terms of the
31 license agreement
32 --*/
33
34 #ifndef _EFI_PLATFORM_EARLY_INIT_H_
35 #define _EFI_PLATFORM_EARLY_INIT_H_
36
37 #define EFI_FORWARD_DECLARATION(x) typedef struct _##x x
38 #include <FrameworkPei.h>
39 #include "PlatformBaseAddresses.h"
40 #include "PchAccess.h"
41 #include "VlvAccess.h"
42 #include "SetupMode.h"
43 #include "PlatformBootMode.h"
44 #include "Platform.h"
45 #include "LegacySpeaker.h"
46
47 #include <Ppi/Stall.h>
48 #include <Guid/PlatformInfo.h>
49 #include <Guid/SetupVariable.h>
50 #include <Ppi/AtaController.h>
51 #include <Ppi/FindFv.h>
52 #include <Ppi/BootInRecoveryMode.h>
53 #include <Ppi/ReadOnlyVariable2.h>
54 #include <Ppi/Capsule.h>
55 #include <Guid/EfiVpdData.h>
56 #include <Library/DebugLib.h>
57 #include <Library/BaseMemoryLib.h>
58 #include <Library/PcdLib.h>
59 #include <Library/IoLib.h>
60 #include <Library/HobLib.h>
61 #include <Library/BaseLib.h>
62 #include <Library/PeiServicesLib.h>
63 #include <Library/MtrrLib.h>
64 #include <Library/CpuIA32.h>
65
66 #include <IndustryStandard/Pci22.h>
67 #include <Ppi/Speaker.h>
68 #include <Guid/FirmwareFileSystem.h>
69 #include <Guid/MemoryTypeInformation.h>
70 #include <Ppi/Cache.h>
71 #include <Ppi/Smbus.h>
72 #include <Library/PchPlatformLib.h>
73 #include <Ppi/SmbusPolicy.h>
74 #include <Ppi/Reset.h>
75 #include <Ppi/EndOfPeiPhase.h>
76 #include <Ppi/MemoryDiscovered.h>
77 #include <Ppi/VlvPolicy.h>
78 #include <Guid/GlobalVariable.h>
79 #include <Ppi/RecoveryModule.h>
80 #include <Ppi/DeviceRecoveryModule.h>
81 #include <Guid/Capsule.h>
82 #include <Guid/RecoveryDevice.h>
83 #include <Ppi/MasterBootMode.h>
84 #include <Guid/PlatformCpuInfo.h>
85 #include <Guid/OsSelection.h>
86 #include <Guid/SmramMemoryReserve.h>
87 #include <Register/Msr.h>
88
89 #define SMC_LAN_ON 0x46
90 #define SMC_LAN_OFF 0x47
91 #define SMC_DEEP_S3_STS 0xB2
92
93
94
95
96 //
97 // Wake Event Types
98 //
99 #define SMBIOS_WAKEUP_TYPE_RESERVED 0x00
100 #define SMBIOS_WAKEUP_TYPE_OTHERS 0x01
101 #define SMBIOS_WAKEUP_TYPE_UNKNOWN 0x02
102 #define SMBIOS_WAKEUP_TYPE_APM_TIMER 0x03
103 #define SMBIOS_WAKEUP_TYPE_MODEM_RING 0x04
104 #define SMBIOS_WAKEUP_TYPE_LAN_REMOTE 0x05
105 #define SMBIOS_WAKEUP_TYPE_POWER_SWITCH 0x06
106 #define SMBIOS_WAKEUP_TYPE_PCI_PME 0x07
107 #define SMBIOS_WAKEUP_TYPE_AC_POWER_RESTORED 0x08
108
109 #define EFI_CPUID_VIRT_PHYS_ADDRESS_SIZE 0x80000008
110
111 //
112 // Defines for stall ppi
113 //
114 #define PEI_STALL_RESOLUTION 1
115
116 //
117 // Used in PEI memory test routines
118 //
119 #define MEMORY_TEST_COVER_SPAN 0x40000
120 #define MEMORY_TEST_PATTERN 0x5A5A5A5A
121
122 #define EFI_LOW_BEEP_FREQUENCY 0x31B
123 #define EFI_HIGH_BEEP_FREQUENCY 0x254
124
125 //
126 // General Purpose Constants
127 //
128 #define ICH_ACPI_TIMER_MAX_VALUE 0x1000000 //The timer is 24 bit overflow
129
130
131
132 //
133 //
134 // GPIO Register Settings for ValleyFalls (Tablet)
135 //
136 //
137 // IO Space configyuration registers
138 // Field Descriptions:
139 // USE: Defines the pin's usage model: GPIO (G) or Native (N) mode.
140 // I/O: Defines whether GPIOs are inputs (I) or outputs (O).
141 // (Note: Only meaningful for pins used as GPIOs.)
142 // LVL: This field gives you the initial value for "output" GPIO's.
143 // (Note: The output level is dependent upon whether the pin is inverted.)
144 // TPE: Defines whether Trigger Positive Edge Enable.
145 // TNE: Defines whether Trigger Negative Edge Enable.
146 // WAKE_EN: only support in SUS community
147 // (Note: Only affects the level sent to the GPE logic and does not
148 // affect the level read through the GPIO registers.)
149 //
150 //
151 // Memory spcae configuration registers
152 //
153 // Field Descriptions:
154 // PAD releated:
155 // PAD_CONF0
156 // PAD_CONF1
157 // PAD_VAL
158 // PAD_DFT
159 //
160 // Notes:
161 // 1. N = Native , G = GPIO , I = Input, O = Output, - = BOTH/NOT SURE
162 //
163 // Signal UsedAs USE I/O LVL TPE TNE PCONF0 PCONF1 PVAL PDFT
164 // -------------------------------------------------------------------------------------------------------------------------
165 // GPIO0 UART1_RXD-L N I - - - cd29h - - -
166 // GPIO1 UART1_TXD-0 N O - - - cd29h - - -
167 // *GPIO2 UART1_RTS_B-1 N I - - - cca9h - - -
168 // *GPIO3 UART1_CTS_B-H N O - - - cca9h - - -
169
170 // GPIO4 I2C1_SDA-OD-O N - - - - cca9h - - -
171 // GPIO5 I2C1_SCL-OD-O N - - - - cca9h - - -
172 // GPIO6 I2S_SYSCLK-0 N O - - - 8d51h - - -
173 // GPIO7 I2S_L_R-0 (SP) N O - - - 8cd1h - - -
174 // GPIO8 I2S_DATA_OUT-0 N O - - - 8cd1h - - -
175 // GPIO9 I2S_SDATA_IN-L N I - - - 8cd1h - - -
176
177 // GPIO10 PCM_CLK-0 N O - - - 8d51h - - -
178 // GPIO11 PCM_FSYNC-0 (SP) N O - - - 8cd1h - - -
179 // GPIO12 PCM_DATA_OUT-0 (SP) N O - - - 8cd1h - - -
180 // GPIO13 PCM_DATA_IN-L N I - - - 8d51h - - -
181
182 // GPIO14 SATA_GP0 N - - - - - - - -
183 // GPIO15 I2C2_SDA-OD-O/I N - - - - ccaah - - -
184
185 // GPIO16 SATA_LEDN N O - - - - - - -
186 // GPIO17 UART2_RTS_B-1 N I - - - cd2ah - - -
187 // GPIO18 UART2_CTS_B-H N O - - - ccaah - - -
188 // GPIO19 UART2_RXD-H N I - - - ccaah - - -
189
190 // GPIO20 I2C2_SCL-OD-O/I N - - - - ccaah - - -
191 // GPIO21 **PCIE_CLKREQ4B N - - - - - - - -
192 // GPIO22 UART2_TXD-0 N O - - - ccaah - - -
193 // GPIO23 FLEX_CLK_SE1 N - - - - - - - -
194
195 // GPIO24 SPI0_SCK-0 N O - - - 8d02h - - -
196 // GPIO25 SPI0_CS-1 N O - - - 8d02h - - -
197 // GPIO26 SPI0_MOSI-0 N O - - - 8d02h - - -
198 // GPIO27 SPI0_MISO-L N I - - - 8d02h - - -
199
200 // GPIO28 UART3_RXD-L N I - - - - - - -
201 // GPIO29 UART3_TXD-0 N O - - - - - - -
202 // GPIO30 UART4_RXD-L N I - - - - - - -
203 // GPIO31 UART4_TXD-0 N O - - - - - - -
204
205 // GPIO32 SDMMC1_CLK N - - - - 208d51h - - -
206 // GPIO33 SDMMC1_D0 N - - - - 8cd1h - - -
207 // GPIO34 SDMMC1_D1 N - - - - 8cd1h - - -
208 // GPIO35 SDMMC1_D2 N - - - - 8cd1h - - -
209 // GPIO36 SDMMC1_D3_CD_B N - - - - 8cd1h - - -
210 // GPIO37 MMC1_D4_SD_WE N - - - - 8cd1h - - -
211 // GPIO38 MMC1_D5 N - - - - 8cd1h - - -
212 // GPIO39 MMC1_D6 N - - - - 8cd1h - - -
213 // GPIO40 MMC1_D7 N - - - - 8cd1h - - -
214 // GPIO41 SDMMC1_CMD N - - - - 8cd1h - - -
215 // GPIO42 MMC1_RESET_B N - - - - 208d51h - - -
216
217 // GPIO43 SDMMC2_CLK N - - - - 208d51h - - -
218 // GPIO44 SDMMC2_D0 N - - - - 8cd1h - - -
219 // GPIO45 SDMMC2_D1 N - - - - 8cd1h - - -
220 // GPIO46 SDMMC2_D2 N - - - - 8cd1h - - -
221 // GPIO47 SDMMC2_D3_CD_B N - - - - 8cd1h - - -
222 // GPIO48 SDMMC2_CMD N - - - - 8cd1h - - -
223
224 // GPIO49 SDMMC3_CLK N - - - - 8d51h - - -
225 // GPIO50 SDMMC3_D0 N - - - - 8cd1h - - -
226 // GPIO51 SDMMC3_D1 N - - - - 8cd1h - - -
227 // GPIO52 SDMMC3_D2 N - - - - 8cd1h - - -
228 // GPIO53 SDMMC3_D3 N - - - - 8cd1h - - -
229 // GPIO54 SDMMC3_CD_B N - - - - cca9h - - -
230 // GPIO55 SDMMC3_CMD N - - - - 8cd1h - - -
231 // GPIO56 SDMMC3_1P8_EN N - - - - cd29h - - -
232
233 // GPIO57 LPC_AD0 N - - - - - - - -
234 // GPIO58 LPC_AD1 N - - - - - - - -
235 // GPIO59 LPC_AD2 N - - - - - - - -
236 // GPIO60 LPC_AD3 N - - - - - - - -
237 // GPIO61 LPC_FRAMEB N O - - - - - - -
238 // GPIO62 LPC_CLKOUT0 N O - - - - - - -
239 // GPIO63 LPC_CLKOUT1 N O - - - - - - -
240 // GPIO64 LPC_CLKRUNB N - - - - - - - -
241
242 // GPIO65 SMB_DATA N - - - - - - - -
243 // GPIO66 SMB_CLK N - - - - - - - -
244 // GPIO67 SMB_ALERTB N - - - - - - - -
245
246 // GPIO68 ILB_SEIRQ N - - - - - - - -
247 // GPIO69 SPKR N O - - - - - - -
248
249 //SUS WELL
250
251 //GPIO_SUS0 BT_WAKEUP_VLV N O - - - CCA8h - - -
252 //GPIO_SUS1 BT_CLOCK_REQ N O - - - CCA8h - - -
253 //GPIO_SUS2 WIFI_PWR_EN N O - - - CCA8h - - -
254 //GPIO_SUS3 SD_CARD_PWR_EN N O - - - CD28h - - -
255 //GPIO_SUS4 GPIO_SUS4 N O - - - CD28h - - -
256 //GPIO_SUS5 GPIO_SUS5 N O - - - CD28h - - -
257 //GPIO_SUS6 SUSPWRDNACK N O - - - 8850h - - -
258 //GPIO_SUS7 PMU_SLP_DDRVTT_B N O - - - 8850h - - -
259 //GPIO_SUS8 PMU_WAKE_B N O - - - CCA8h - - -
260 //GPIO_SUS9 PMU_PWRBTN_B N O - - - CCA8h - - -
261 //GPIO_SUS10 PMU_WAKE_LAN_B N O - - - CCA8h - - -
262 //GPIO_SUS11 SUS_STAT_B N O - - - C828h - - -
263 //GPIO_SUS12 GPIO_SUS12 N O - - - C828h - - -
264 //GPIO_SUS13 USB_OC0_B-20K,H N O - - - CCA8h - - -
265 //GPIO_SUS14 GPIO_SUS14 N O - - - CCA8h - - -
266 //GPIO_SUS15 SPI_CS1_B-20K,H N O - - - 8C80h - - -
267 //GPIO_SUS16 PMU_SUSCLK N O - - - C828h - - -
268 //
269
270
271 #define VF_TAB_GPIO_USE_SEL_VAL_0_31 0x00000000
272 #define VF_TAB_GPIO_USE_SEL_VAL_32_63 0x00000000
273 #define VF_TAB_GPIO_USE_SEL_VAL_64_70 0x00000000
274 #define VF_TAB_GPIO_USE_SEL_VAL_SUS 0x00000000
275
276 //
277 //1010 --00 0100 01-- 0101 --0- 0001 1010
278 //
279 #define VF_TAB_GPIO_IO_SEL_VAL_0_31 0x00000000 // BIT30 | BIT28 | BIT27 | BIT19 | BIT17 | BIT13 | BIT9 | BIT2 | BIT0
280 #define VF_TAB_GPIO_IO_SEL_VAL_32_63 0x00000000
281 #define VF_TAB_GPIO_IO_SEL_VAL_64_70 0x00000000
282 #define VF_TAB_GPIO_IO_SEL_VAL_SUS 0x00000000
283
284
285 #define VF_TAB_GPIO_LVL_VAL_0_31 0x00000000
286 #define VF_TAB_GPIO_LVL_VAL_32_63 0x00000000
287 #define VF_TAB_GPIO_LVL_VAL_64_70 0x00000000
288 #define VF_TAB_GPIO_LVL_VAL_SUS 0x00000000
289
290 #define VF_TAB_GPIO_TPE_VAL_0_31 0x00000000
291 #define VF_TAB_GPIO_TPE_VAL_SUS 0x00000000
292
293 #define VF_TAB_GPIO_TNE_VAL_0_31 0x00000000
294 #define VF_TAB_GPIO_TNE_VAL_SUS 0x00000000
295
296 #define VF_TAB_GPIO_TS_VAL_0_31 0x00000000
297 #define VF_TAB_GPIO_TS_VAL_SUS 0x00000000
298
299
300 //
301 // Memory space registers
302 //
303
304 //
305 // CONF0
306 //
307 #define VF_TAB_PAD_CONF0_GPIO0 0xcd29
308 #define VF_TAB_PAD_CONF0_GPIO1 0xcd29
309 #define VF_TAB_PAD_CONF0_GPIO2 0xcca9
310 #define VF_TAB_PAD_CONF0_GPIO3 0xcca9
311 #define VF_TAB_PAD_CONF0_GPIO4 0xcca9
312 #define VF_TAB_PAD_CONF0_GPIO5 0xcca9
313 #define VF_TAB_PAD_CONF0_GPIO6 0x8d51
314 #define VF_TAB_PAD_CONF0_GPIO7 0x8cd1
315 #define VF_TAB_PAD_CONF0_GPIO8 0x8cd1
316 #define VF_TAB_PAD_CONF0_GPIO9 0x8cd1
317 #define VF_TAB_PAD_CONF0_GPIO10 0x8d51
318 #define VF_TAB_PAD_CONF0_GPIO11 0x8cd1
319 #define VF_TAB_PAD_CONF0_GPIO12 0x8cd1
320 #define VF_TAB_PAD_CONF0_GPIO13 0x8d51
321 #define VF_TAB_PAD_CONF0_GPIO14 0xCCA8
322 #define VF_TAB_PAD_CONF0_GPIO15 0xccaa
323 #define VF_TAB_PAD_CONF0_GPIO16 0xC828
324 #define VF_TAB_PAD_CONF0_GPIO17 0xcd2a
325 #define VF_TAB_PAD_CONF0_GPIO18 0xccaa
326 #define VF_TAB_PAD_CONF0_GPIO19 0xccaa
327 #define VF_TAB_PAD_CONF0_GPIO20 0xccaa
328 #define VF_TAB_PAD_CONF0_GPIO21 0xCCA9
329 #define VF_TAB_PAD_CONF0_GPIO22 0xccaa
330 #define VF_TAB_PAD_CONF0_GPIO23 0xCD2A
331 #define VF_TAB_PAD_CONF0_GPIO24 0x8d02
332 #define VF_TAB_PAD_CONF0_GPIO25 0x8d02
333 #define VF_TAB_PAD_CONF0_GPIO26 0x8d02
334 #define VF_TAB_PAD_CONF0_GPIO27 0x8d02
335 #define VF_TAB_PAD_CONF0_GPIO28 0x8D02
336 #define VF_TAB_PAD_CONF0_GPIO29 0x8D02
337 #define VF_TAB_PAD_CONF0_GPIO30 0x8D00
338 #define VF_TAB_PAD_CONF0_GPIO31 0xCD2A
339 #define VF_TAB_PAD_CONF0_GPIO32 0x208d51
340 #define VF_TAB_PAD_CONF0_GPIO33 0x8cd1
341 #define VF_TAB_PAD_CONF0_GPIO34 0x8cd1
342 #define VF_TAB_PAD_CONF0_GPIO35 0x8cd1
343 #define VF_TAB_PAD_CONF0_GPIO36 0x8cd1
344 #define VF_TAB_PAD_CONF0_GPIO37 0x8cd1
345 #define VF_TAB_PAD_CONF0_GPIO38 0x8cd1
346 #define VF_TAB_PAD_CONF0_GPIO39 0x8cd1
347 #define VF_TAB_PAD_CONF0_GPIO40 0x8cd1
348 #define VF_TAB_PAD_CONF0_GPIO41 0x8cd1
349 #define VF_TAB_PAD_CONF0_GPIO42 0x208d51
350 #define VF_TAB_PAD_CONF0_GPIO43 0x208d51
351 #define VF_TAB_PAD_CONF0_GPIO44 0x8cd1
352 #define VF_TAB_PAD_CONF0_GPIO45 0x8cd1
353 #define VF_TAB_PAD_CONF0_GPIO46 0x8cd1
354 #define VF_TAB_PAD_CONF0_GPIO47 0x8cd1
355 #define VF_TAB_PAD_CONF0_GPIO48 0x8cd1
356 #define VF_TAB_PAD_CONF0_GPIO49 0x8d51
357 #define VF_TAB_PAD_CONF0_GPIO50 0x8cd1
358 #define VF_TAB_PAD_CONF0_GPIO51 0x8cd1
359 #define VF_TAB_PAD_CONF0_GPIO52 0x8cd1
360 #define VF_TAB_PAD_CONF0_GPIO53 0x8cd1
361 #define VF_TAB_PAD_CONF0_GPIO54 0xcca9
362 #define VF_TAB_PAD_CONF0_GPIO55 0x8cd1
363 #define VF_TAB_PAD_CONF0_GPIO56 0xcd29
364 #define VF_TAB_PAD_CONF0_GPIO57 0x8C80
365 #define VF_TAB_PAD_CONF0_GPIO58 0x8C80
366 #define VF_TAB_PAD_CONF0_GPIO59 0x8C80
367 #define VF_TAB_PAD_CONF0_GPIO60 0x8C80
368 #define VF_TAB_PAD_CONF0_GPIO61 0x8800
369 #define VF_TAB_PAD_CONF0_GPIO62 0x8D00
370 #define VF_TAB_PAD_CONF0_GPIO63 0x8800
371 #define VF_TAB_PAD_CONF0_GPIO64 0x8800
372 #define VF_TAB_PAD_CONF0_GPIO65 0xC828
373 #define VF_TAB_PAD_CONF0_GPIO66 0xC828
374 #define VF_TAB_PAD_CONF0_GPIO67 0xC828
375 #define VF_TAB_PAD_CONF0_GPIO68 0xCCA8
376 #define VF_TAB_PAD_CONF0_GPIO69 0xC828
377 #define VF_TAB_PAD_CONF0_GPIO70 0xCCA8
378
379
380
381 //
382 // PAD_CONF1
383 //
384 #define VF_TAB_PAD_CONF1_GPIO0 0x20002
385 #define VF_TAB_PAD_CONF1_GPIO1 0x20002
386 #define VF_TAB_PAD_CONF1_GPIO2 0x20002
387 #define VF_TAB_PAD_CONF1_GPIO3 0x20002
388 #define VF_TAB_PAD_CONF1_GPIO4 0x20002
389 #define VF_TAB_PAD_CONF1_GPIO5 0x20002
390 #define VF_TAB_PAD_CONF1_GPIO6 0x1F000F
391 #define VF_TAB_PAD_CONF1_GPIO7 0x1F000F
392 #define VF_TAB_PAD_CONF1_GPIO8 0x1F000F
393 #define VF_TAB_PAD_CONF1_GPIO9 0x1F000F
394 #define VF_TAB_PAD_CONF1_GPIO10 0x1F000F
395 #define VF_TAB_PAD_CONF1_GPIO11 0x1F000F
396 #define VF_TAB_PAD_CONF1_GPIO12 0x1F000F
397 #define VF_TAB_PAD_CONF1_GPIO13 0x1F000F
398 #define VF_TAB_PAD_CONF1_GPIO14 0x20002
399 #define VF_TAB_PAD_CONF1_GPIO15 0x20002
400 #define VF_TAB_PAD_CONF1_GPIO16 0x20002
401 #define VF_TAB_PAD_CONF1_GPIO17 0x20002
402 #define VF_TAB_PAD_CONF1_GPIO18 0x20002
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455
456
457 //
458 // PAD_VAL
459 //
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503 #define VF_TAB_PAD_VAL_GPIO43 0x2
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531
532
533 //
534 // PAD_DFT
535 //
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601 #define VF_TAB_PAD_DFT_GPIO65 0xC
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603 #define VF_TAB_PAD_DFT_GPIO67 0xC
604 #define VF_TAB_PAD_DFT_GPIO68 0xC
605 #define VF_TAB_PAD_DFT_GPIO69 0xC
606 #define VF_TAB_PAD_DFT_GPIO70 0xC
607
608
609 //
610 //SUS WELL
611 //
612
613 //
614 // CONF0
615 //
616 #define VF_TAB_PAD_CONF0_GPIO_SUS0 0xCCA8
617 #define VF_TAB_PAD_CONF0_GPIO_SUS1 0xCCA8
618 #define VF_TAB_PAD_CONF0_GPIO_SUS2 0xCCA8
619 #define VF_TAB_PAD_CONF0_GPIO_SUS3 0xCD28
620 #define VF_TAB_PAD_CONF0_GPIO_SUS4 0xCD28
621 #define VF_TAB_PAD_CONF0_GPIO_SUS5 0xCD28
622 #define VF_TAB_PAD_CONF0_GPIO_SUS6 0x8850
623 #define VF_TAB_PAD_CONF0_GPIO_SUS7 0x8850
624 #define VF_TAB_PAD_CONF0_GPIO_SUS8 0xCCA8
625 #define VF_TAB_PAD_CONF0_GPIO_SUS9 0xCCA8
626 #define VF_TAB_PAD_CONF0_GPIO_SUS10 0xCCA8
627 #define VF_TAB_PAD_CONF0_GPIO_SUS11 0xC828
628 #define VF_TAB_PAD_CONF0_GPIO_SUS12 0xC828
629 #define VF_TAB_PAD_CONF0_GPIO_SUS13 0xCCA8
630 #define VF_TAB_PAD_CONF0_GPIO_SUS14 0xCCA8
631 #define VF_TAB_PAD_CONF0_GPIO_SUS15 0x8C80
632 #define VF_TAB_PAD_CONF0_GPIO_SUS16 0xC828
633
634 //
635 // CONF1
636 //
637 #define VF_TAB_PAD_CONF1_GPIO_SUS0 0
638 #define VF_TAB_PAD_CONF1_GPIO_SUS1 0
639 #define VF_TAB_PAD_CONF1_GPIO_SUS2 0
640 #define VF_TAB_PAD_CONF1_GPIO_SUS3 0
641 #define VF_TAB_PAD_CONF1_GPIO_SUS4 0
642 #define VF_TAB_PAD_CONF1_GPIO_SUS5 0
643 #define VF_TAB_PAD_CONF1_GPIO_SUS6 0
644 #define VF_TAB_PAD_CONF1_GPIO_SUS7 0
645 #define VF_TAB_PAD_CONF1_GPIO_SUS8 0
646 #define VF_TAB_PAD_CONF1_GPIO_SUS9 0
647 #define VF_TAB_PAD_CONF1_GPIO_SUS10 0
648 #define VF_TAB_PAD_CONF1_GPIO_SUS11 0
649 #define VF_TAB_PAD_CONF1_GPIO_SUS12 0
650 #define VF_TAB_PAD_CONF1_GPIO_SUS13 0
651 #define VF_TAB_PAD_CONF1_GPIO_SUS14 0
652 #define VF_TAB_PAD_CONF1_GPIO_SUS15 0
653 #define VF_TAB_PAD_CONF1_GPIO_SUS16 0
654
655 //
656 // PAD_VAL
657 //
658 #define VF_TAB_PAD_VAL_GPIO_SUS0 0
659 #define VF_TAB_PAD_VAL_GPIO_SUS1 0
660 #define VF_TAB_PAD_VAL_GPIO_SUS2 0
661 #define VF_TAB_PAD_VAL_GPIO_SUS3 0
662 #define VF_TAB_PAD_VAL_GPIO_SUS4 0
663 #define VF_TAB_PAD_VAL_GPIO_SUS5 0
664 #define VF_TAB_PAD_VAL_GPIO_SUS6 0
665 #define VF_TAB_PAD_VAL_GPIO_SUS7 0
666 #define VF_TAB_PAD_VAL_GPIO_SUS8 0
667 #define VF_TAB_PAD_VAL_GPIO_SUS9 0
668 #define VF_TAB_PAD_VAL_GPIO_SUS10 0
669 #define VF_TAB_PAD_VAL_GPIO_SUS11 0
670 #define VF_TAB_PAD_VAL_GPIO_SUS12 0
671 #define VF_TAB_PAD_VAL_GPIO_SUS13 0
672 #define VF_TAB_PAD_VAL_GPIO_SUS14 0
673 #define VF_TAB_PAD_VAL_GPIO_SUS15 0
674 #define VF_TAB_PAD_VAL_GPIO_SUS16 0
675
676 //
677 // PAD_DFT
678 //
679 #define VF_TAB_PAD_DFT_GPIO_SUS0 0
680 #define VF_TAB_PAD_DFT_GPIO_SUS1 0
681 #define VF_TAB_PAD_DFT_GPIO_SUS2 0
682 #define VF_TAB_PAD_DFT_GPIO_SUS3 0
683 #define VF_TAB_PAD_DFT_GPIO_SUS4 0
684 #define VF_TAB_PAD_DFT_GPIO_SUS5 0
685 #define VF_TAB_PAD_DFT_GPIO_SUS6 0
686 #define VF_TAB_PAD_DFT_GPIO_SUS7 0
687 #define VF_TAB_PAD_DFT_GPIO_SUS8 0
688 #define VF_TAB_PAD_DFT_GPIO_SUS9 0
689 #define VF_TAB_PAD_DFT_GPIO_SUS10 0
690 #define VF_TAB_PAD_DFT_GPIO_SUS11 0
691 #define VF_TAB_PAD_DFT_GPIO_SUS12 0
692 #define VF_TAB_PAD_DFT_GPIO_SUS13 0
693 #define VF_TAB_PAD_DFT_GPIO_SUS14 0
694 #define VF_TAB_PAD_DFT_GPIO_SUS15 0
695 #define VF_TAB_PAD_DFT_GPIO_SUS16 0
696
697
698 //
699 //
700 // GPIO Register Settings for ValleyFalls (Netbook)
701 //
702 //
703 // IO Space configyuration registers
704 // Field Descriptions:
705 // USE: Defines the pin's usage model: GPIO (G) or Native (N) mode.
706 // I/O: Defines whether GPIOs are inputs (I) or outputs (O).
707 // (Note: Only meaningful for pins used as GPIOs.)
708 // LVL: This field gives you the initial value for "output" GPIO's.
709 // (Note: The output level is dependent upon whether the pin is inverted.)
710 // TPE: Defines whether Trigger Positive Edge Enable.
711 // TNE: Defines whether Trigger Negative Edge Enable.
712 // WAKE_EN: only support in SUS community
713 // (Note: Only affects the level sent to the GPE logic and does not
714 // affect the level read through the GPIO registers.)
715 //
716 //
717 // Memory spcae configuration registers
718 //
719 // Field Descriptions:
720 // PAD releated:
721 // PAD_CONF0
722 // PAD_CONF1
723 // PAD_VAL
724 // PAD_DFT
725 //
726 // Notes:
727 // 1. N = Native , G = GPIO , I = Input, O = Output, - = BOTH/NOT SURE
728 //
729 // Signal UsedAs USE I/O LVL TPE TNE PCONF0 PCONF1 PVAL PDFT
730 // -------------------------------------------------------------------------------------------------------------------------
731 // GPIO0 UART1_RXD-L N I - - - cd29h - - -
732 // GPIO1 UART1_TXD-0 N O - - - cd29h - - -
733 // *GPIO2 UART1_RTS_B-1 N I - - - cca9h - - -
734 // *GPIO3 UART1_CTS_B-H N O - - - cca9h - - -
735
736 // GPIO4 NMI_B-H G - - - - cca9h - - -
737 // GPIO5 GPIO_D5 G - - - - cca9h - - -
738 // GPIO6 GPIO_D6 G O - - - 8d51h - - -
739 // GPIO7 GPIO_D7 G O - - - 8cd1h - - -
740 // GPIO8 GPIO_D8 G O - - - 8cd1h - - -
741 // GPIO9 GPIO_D9 G I - - - 8cd1h - - -
742
743 // GPIO10 GPIO_D10 G O - - - 8d51h - - -
744 // GPIO11 GPIO_D11 G O - - - 8cd1h - - -
745 // GPIO12 GPIO_D12 G O - - - 8cd1h - - -
746 // GPIO13 GPIO_D13 G I - - - 8d51h - - -
747
748 // GPIO14 SATA_GP0 N - - - - - - - -
749 // GPIO15 SATA_GP1-L N - - - - ccaah - - -
750
751 // GPIO16 SATA_LEDN-OD-O N O - - - - - - -
752 // GPIO17 PCIE_CLKREQ0B-20K,H N I - - - cd2ah - - -
753 // GPIO18 PCIE_CLKREQ1B-20K,H N O - - - ccaah - - -
754 // GPIO19 PCIE_CLKREQ2B-20K,H N I - - - ccaah - - -
755 // GPIO20 PCIE_CLKREQ3B-20K,H N - - - - ccaah - - -
756 // GPIO21 PCIE_CLKREQ4B-20K,H N - - - - - - - -
757 // GPIO22 FLEX_CLK_SE0-20K,L N O - - - ccaah - - -
758 // GPIO23 FLEX_CLK_SE1-20K,L N - - - - - - - -
759
760 // GPIO24 HDA_RSTB N O - - - 8d02h - - -
761 // GPIO25 HDA_SYNC N O - - - 8d02h - - -
762 // GPIO26 HDA_CLK N O - - - 8d02h - - -
763 // GPIO27 HDA_SDO N I - - - 8d02h - - -
764 // GPIO28 HDA_SDI0 N I - - - - - - -
765 // GPIO29 HDA_SDI1 N O - - - - - - -
766 // GPIO30 HDA_DOCKRSTB N I - - - - - - -
767 // GPIO31 HDA_DOCKENB N O - - - - - - -
768
769 // GPIO32 SDMMC1_CLK N - - - - 208d51h - - -
770 // GPIO33 SDMMC1_D0 N - - - - 8cd1h - - -
771 // GPIO34 SDMMC1_D1 N - - - - 8cd1h - - -
772 // GPIO35 SDMMC1_D2 N - - - - 8cd1h - - -
773 // GPIO36 SDMMC1_D3_CD_B N - - - - 8cd1h - - -
774 // GPIO37 MMC1_D4_SD_WE N - - - - 8cd1h - - -
775 // GPIO38 MMC1_D5 N - - - - 8cd1h - - -
776 // GPIO39 MMC1_D6 N - - - - 8cd1h - - -
777 // GPIO40 MMC1_D7 N - - - - 8cd1h - - -
778 // GPIO41 SDMMC1_CMD N - - - - 8cd1h - - -
779 // GPIO42 MMC1_RESET_B N - - - - 208d51h - - -
780
781 // GPIO43 SDMMC2_CLK N - - - - 208d51h - - -
782 // GPIO44 SDMMC2_D0 N - - - - 8cd1h - - -
783 // GPIO45 SDMMC2_D1 N - - - - 8cd1h - - -
784 // GPIO46 SDMMC2_D2 N - - - - 8cd1h - - -
785 // GPIO47 SDMMC2_D3_CD_B N - - - - 8cd1h - - -
786 // GPIO48 SDMMC2_CMD N - - - - 8cd1h - - -
787
788 // GPIO49 SDMMC3_CLK N - - - - 8d51h - - -
789 // GPIO50 SDMMC3_D0 N - - - - 8cd1h - - -
790 // GPIO51 SDMMC3_D1 N - - - - 8cd1h - - -
791 // GPIO52 SDMMC3_D2 N - - - - 8cd1h - - -
792 // GPIO53 SDMMC3_D3 N - - - - 8cd1h - - -
793 // GPIO54 SDMMC3_CD_B N - - - - cca9h - - -
794 // GPIO55 SDMMC3_CMD N - - - - 8cd1h - - -
795 // GPIO56 SDMMC3_1P8_EN N - - - - cd29h - - -
796
797 // GPIO57 LPC_AD0 N - - - - - - - -
798 // GPIO58 LPC_AD1 N - - - - - - - -
799 // GPIO59 LPC_AD2 N - - - - - - - -
800 // GPIO60 LPC_AD3 N - - - - - - - -
801 // GPIO61 LPC_FRAMEB N O - - - - - - -
802 // GPIO62 LPC_CLKOUT0 N O - - - - - - -
803 // GPIO63 LPC_CLKOUT1 N O - - - - - - -
804 // GPIO64 LPC_CLKRUNB N - - - - - - - -
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806 // GPIO65 SMB_DATA N - - - - - - - -
807 // GPIO66 SMB_CLK N - - - - - - - -
808 // GPIO67 SMB_ALERTB N - - - - - - - -
809
810 // GPIO68 ILB_SEIRQ N - - - - - - - -
811 // GPIO69 SPKR N O - - - - - - -
812
813 //SUS WELL
814
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816 //GPIO_SUS0 GPIO_SUS0 N O - - - CCA8h - - -
817 //GPIO_SUS1 GPIO_SUS1 N O - - - CCA8h - - -
818 //GPIO_SUS2 GPIO_SUS2 N O - - - CCA8h - - -
819 //GPIO_SUS3 GPIO_SUS3 N O - - - CD28h - - -
820 //GPIO_SUS4 GPIO_SUS4 N O - - - CD28h - - -
821 //GPIO_SUS5 GPIO_SUS5 N O - - - CD28h - - -
822 //GPIO_SUS6 SUSPWRDNACK-0 N O - - - 8850h - - -
823 //GPIO_SUS7 PMU_SLP_DDRVTT_B-0 N O - - - 8850h - - -
824 //GPIO_SUS8 PMU_WAKE_B-20K,H N O - - - CCA8h - - -
825 //GPIO_SUS9 PMU_PWRBTN_B-20K,H N O - - - CCA8h - - -
826 //GPIO_SUS10 PMU_WAKE_LAN_B-20K,H N O - - - CCA8h - - -
827 //GPIO_SUS11 SUS_STAT_B-1 N O - - - C828h - - -
828 //GPIO_SUS12 PMU_SUSCLK-0 N O - - - C828h - - -
829 //GPIO_SUS13 USB_OC0_B-20K,H N O - - - CCA8h - - -
830 //GPIO_SUS14 USB_OC1_B-20K,H N O - - - CCA8h - - -
831 //GPIO_SUS15 SPI_CS1_B-20K,H N O - - - 8C80h - - -
832 //GPIO_SUS16 SPI_CS1_B-20K,H N O - - - C828h - - -
833 //
834
835 #define VF_NET_GPIO_USE_SEL_VAL_0_31 0x00000000
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838 #define VF_NET_GPIO_USE_SEL_VAL_SUS 0x00000000
839
840 //
841 //1010 --00 0100 01-- 0101 --0- 0001 1010
842 //
843 #define VF_NET_GPIO_IO_SEL_VAL_0_31 0x00000000 // BIT30 | BIT28 | BIT27 | BIT19 | BIT17 | BIT13 | BIT9 | BIT2 | BIT0
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845 #define VF_NET_GPIO_IO_SEL_VAL_64_70 0x00000000
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863
864 //
865 // Memory space registers
866 //
867
868
869 //
870 // CONF0
871 //
872 #define VF_NET_PAD_CONF0_GPIO0 0xcd29
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944
945
946
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948 // PAD_CONF1
949 //
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1099
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1110 #define VF_NET_PAD_DFT_GPIO7 0xC
1111 #define VF_NET_PAD_DFT_GPIO8 0xC
1112 #define VF_NET_PAD_DFT_GPIO9 0xC
1113 #define VF_NET_PAD_DFT_GPIO10 0xC
1114 #define VF_NET_PAD_DFT_GPIO11 0xC
1115 #define VF_NET_PAD_DFT_GPIO12 0xC
1116 #define VF_NET_PAD_DFT_GPIO13 0xC
1117 #define VF_NET_PAD_DFT_GPIO14 0xC
1118 #define VF_NET_PAD_DFT_GPIO15 0xC
1119 #define VF_NET_PAD_DFT_GPIO16 0xC
1120 #define VF_NET_PAD_DFT_GPIO17 0xC
1121 #define VF_NET_PAD_DFT_GPIO18 0xC
1122 #define VF_NET_PAD_DFT_GPIO19 0xC
1123 #define VF_NET_PAD_DFT_GPIO20 0xC
1124 #define VF_NET_PAD_DFT_GPIO21 0xC
1125 #define VF_NET_PAD_DFT_GPIO22 0xC
1126 #define VF_NET_PAD_DFT_GPIO23 0xC
1127 #define VF_NET_PAD_DFT_GPIO24 0xC
1128 #define VF_NET_PAD_DFT_GPIO25 0xC
1129 #define VF_NET_PAD_DFT_GPIO26 0xC
1130 #define VF_NET_PAD_DFT_GPIO27 0xC
1131 #define VF_NET_PAD_DFT_GPIO28 0xC
1132 #define VF_NET_PAD_DFT_GPIO29 0xC
1133 #define VF_NET_PAD_DFT_GPIO30 0xC
1134 #define VF_NET_PAD_DFT_GPIO31 0xC
1135 #define VF_NET_PAD_DFT_GPIO32 0xC
1136 #define VF_NET_PAD_DFT_GPIO33 0xC
1137 #define VF_NET_PAD_DFT_GPIO34 0xC
1138 #define VF_NET_PAD_DFT_GPIO35 0xC
1139 #define VF_NET_PAD_DFT_GPIO36 0xC
1140 #define VF_NET_PAD_DFT_GPIO37 0xC
1141 #define VF_NET_PAD_DFT_GPIO38 0xC
1142 #define VF_NET_PAD_DFT_GPIO39 0xC
1143 #define VF_NET_PAD_DFT_GPIO40 0xC
1144 #define VF_NET_PAD_DFT_GPIO41 0xC
1145 #define VF_NET_PAD_DFT_GPIO42 0xC
1146 #define VF_NET_PAD_DFT_GPIO43 0xC
1147 #define VF_NET_PAD_DFT_GPIO44 0xC
1148 #define VF_NET_PAD_DFT_GPIO45 0xC
1149 #define VF_NET_PAD_DFT_GPIO46 0xC
1150 #define VF_NET_PAD_DFT_GPIO47 0xC
1151 #define VF_NET_PAD_DFT_GPIO48 0xC
1152 #define VF_NET_PAD_DFT_GPIO49 0xC
1153 #define VF_NET_PAD_DFT_GPIO50 0xC
1154 #define VF_NET_PAD_DFT_GPIO51 0xC
1155 #define VF_NET_PAD_DFT_GPIO52 0xC
1156 #define VF_NET_PAD_DFT_GPIO53 0xC
1157 #define VF_NET_PAD_DFT_GPIO54 0xC
1158 #define VF_NET_PAD_DFT_GPIO55 0xC
1159 #define VF_NET_PAD_DFT_GPIO56 0xC
1160 #define VF_NET_PAD_DFT_GPIO57 0xC
1161 #define VF_NET_PAD_DFT_GPIO58 0xC
1162 #define VF_NET_PAD_DFT_GPIO59 0xC
1163 #define VF_NET_PAD_DFT_GPIO60 0xC
1164 #define VF_NET_PAD_DFT_GPIO61 0xC
1165 #define VF_NET_PAD_DFT_GPIO62 0xC
1166 #define VF_NET_PAD_DFT_GPIO63 0xC
1167 #define VF_NET_PAD_DFT_GPIO64 0xC
1168 #define VF_NET_PAD_DFT_GPIO65 0xC
1169 #define VF_NET_PAD_DFT_GPIO66 0xC
1170 #define VF_NET_PAD_DFT_GPIO67 0xC
1171 #define VF_NET_PAD_DFT_GPIO68 0xC
1172 #define VF_NET_PAD_DFT_GPIO69 0xC
1173 #define VF_NET_PAD_DFT_GPIO70 0xC
1174
1175 //
1176 // PCONF0
1177 //
1178 #define VF_NET_PAD_CONF0_GPIO_SUS0 0xCCA8
1179 #define VF_NET_PAD_CONF0_GPIO_SUS1 0xCCA8
1180 #define VF_NET_PAD_CONF0_GPIO_SUS2 0xCCA8
1181 #define VF_NET_PAD_CONF0_GPIO_SUS3 0xCD28
1182 #define VF_NET_PAD_CONF0_GPIO_SUS4 0xCD28
1183 #define VF_NET_PAD_CONF0_GPIO_SUS5 0xCD28
1184 #define VF_NET_PAD_CONF0_GPIO_SUS6 0x8850
1185 #define VF_NET_PAD_CONF0_GPIO_SUS7 0x8850
1186 #define VF_NET_PAD_CONF0_GPIO_SUS8 0xCCA8
1187 #define VF_NET_PAD_CONF0_GPIO_SUS9 0xCCA8
1188 #define VF_NET_PAD_CONF0_GPIO_SUS10 0xCCA8
1189 #define VF_NET_PAD_CONF0_GPIO_SUS11 0xC828
1190 #define VF_NET_PAD_CONF0_GPIO_SUS12 0xC828
1191 #define VF_NET_PAD_CONF0_GPIO_SUS13 0xCCA8
1192 #define VF_NET_PAD_CONF0_GPIO_SUS14 0xCCA8
1193 #define VF_NET_PAD_CONF0_GPIO_SUS15 0x8C80
1194 #define VF_NET_PAD_CONF0_GPIO_SUS16 0xC828
1195
1196 //
1197 // PCONF1
1198 //
1199 #define VF_NET_PAD_CONF1_GPIO_SUS0 0
1200 #define VF_NET_PAD_CONF1_GPIO_SUS1 0
1201 #define VF_NET_PAD_CONF1_GPIO_SUS2 0
1202 #define VF_NET_PAD_CONF1_GPIO_SUS3 0
1203 #define VF_NET_PAD_CONF1_GPIO_SUS4 0
1204 #define VF_NET_PAD_CONF1_GPIO_SUS5 0
1205 #define VF_NET_PAD_CONF1_GPIO_SUS6 0
1206 #define VF_NET_PAD_CONF1_GPIO_SUS7 0
1207 #define VF_NET_PAD_CONF1_GPIO_SUS8 0
1208 #define VF_NET_PAD_CONF1_GPIO_SUS9 0
1209 #define VF_NET_PAD_CONF1_GPIO_SUS10 0
1210 #define VF_NET_PAD_CONF1_GPIO_SUS11 0
1211 #define VF_NET_PAD_CONF1_GPIO_SUS12 0
1212 #define VF_NET_PAD_CONF1_GPIO_SUS13 0
1213 #define VF_NET_PAD_CONF1_GPIO_SUS14 0
1214 #define VF_NET_PAD_CONF1_GPIO_SUS15 0
1215 #define VF_NET_PAD_CONF1_GPIO_SUS16 0
1216
1217
1218 #define VF_NET_PAD_VAL_GPIO_SUS0 0
1219 #define VF_NET_PAD_VAL_GPIO_SUS1 0
1220 #define VF_NET_PAD_VAL_GPIO_SUS2 0
1221 #define VF_NET_PAD_VAL_GPIO_SUS3 0
1222 #define VF_NET_PAD_VAL_GPIO_SUS4 0
1223 #define VF_NET_PAD_VAL_GPIO_SUS5 0
1224 #define VF_NET_PAD_VAL_GPIO_SUS6 0
1225 #define VF_NET_PAD_VAL_GPIO_SUS7 0
1226 #define VF_NET_PAD_VAL_GPIO_SUS8 0
1227 #define VF_NET_PAD_VAL_GPIO_SUS9 0
1228 #define VF_NET_PAD_VAL_GPIO_SUS10 0
1229 #define VF_NET_PAD_VAL_GPIO_SUS11 0
1230 #define VF_NET_PAD_VAL_GPIO_SUS12 0
1231 #define VF_NET_PAD_VAL_GPIO_SUS13 0
1232 #define VF_NET_PAD_VAL_GPIO_SUS14 0
1233 #define VF_NET_PAD_VAL_GPIO_SUS15 0
1234 #define VF_NET_PAD_VAL_GPIO_SUS16 0
1235
1236
1237 #define VF_NET_PAD_DFT_GPIO_SUS0 0
1238 #define VF_NET_PAD_DFT_GPIO_SUS1 0
1239 #define VF_NET_PAD_DFT_GPIO_SUS2 0
1240 #define VF_NET_PAD_DFT_GPIO_SUS3 0
1241 #define VF_NET_PAD_DFT_GPIO_SUS4 0
1242 #define VF_NET_PAD_DFT_GPIO_SUS5 0
1243 #define VF_NET_PAD_DFT_GPIO_SUS6 0
1244 #define VF_NET_PAD_DFT_GPIO_SUS7 0
1245 #define VF_NET_PAD_DFT_GPIO_SUS8 0
1246 #define VF_NET_PAD_DFT_GPIO_SUS9 0
1247 #define VF_NET_PAD_DFT_GPIO_SUS10 0
1248 #define VF_NET_PAD_DFT_GPIO_SUS11 0
1249 #define VF_NET_PAD_DFT_GPIO_SUS12 0
1250 #define VF_NET_PAD_DFT_GPIO_SUS13 0
1251 #define VF_NET_PAD_DFT_GPIO_SUS14 0
1252 #define VF_NET_PAD_DFT_GPIO_SUS15 0
1253 #define VF_NET_PAD_DFT_GPIO_SUS16 0
1254
1255
1256 //
1257 // Function Prototypes
1258 //
1259 EFI_STATUS
1260 PlatformPchInit (
1261 IN SYSTEM_CONFIGURATION *SystemConfiguration,
1262 IN CONST EFI_PEI_SERVICES **PeiServices,
1263 IN UINT16 PlatformType
1264 );
1265
1266 EFI_STATUS
1267 PlatformCpuInit (
1268 IN CONST EFI_PEI_SERVICES **PeiServices,
1269 IN SYSTEM_CONFIGURATION *SystemConfiguration,
1270 IN EFI_PLATFORM_CPU_INFO *PlatformCpuInfo
1271 );
1272
1273 EFI_STATUS
1274 PeimInitializeFlashMap (
1275 IN EFI_FFS_FILE_HEADER *FfsHeader,
1276 IN CONST EFI_PEI_SERVICES **PeiServices
1277 );
1278
1279 EFI_STATUS
1280 PeimInstallFlashMapPpi (
1281 IN EFI_FFS_FILE_HEADER *FfsHeader,
1282 IN CONST EFI_PEI_SERVICES **PeiServices
1283 );
1284
1285 EFI_STATUS
1286 EFIAPI
1287 IchReset (
1288 IN CONST EFI_PEI_SERVICES **PeiServices
1289 )
1290 ;
1291
1292 BOOLEAN
1293 GetSleepTypeAfterWakeup (
1294 IN CONST EFI_PEI_SERVICES **PeiServices,
1295 OUT UINT16 *SleepType
1296 );
1297
1298 EFI_STATUS
1299 EFIAPI
1300 GetWakeupEventAndSaveToHob (
1301 IN CONST EFI_PEI_SERVICES **PeiServices
1302 )
1303 ;
1304
1305 EFI_STATUS
1306 EFIAPI
1307 MemoryDiscoveredPpiNotifyCallback (
1308 IN CONST EFI_PEI_SERVICES **PeiServices,
1309 IN EFI_PEI_NOTIFY_DESCRIPTOR *NotifyDescriptor,
1310 IN VOID *Ppi
1311 )
1312 ;
1313
1314 EFI_STATUS
1315 EFIAPI
1316 PeiGetVariable (
1317 IN CONST EFI_PEI_SERVICES **PeiServices,
1318 IN CHAR16 *VariableName,
1319 IN EFI_GUID * VendorGuid,
1320 OUT UINT32 *Attributes OPTIONAL,
1321 IN OUT UINTN *DataSize,
1322 OUT VOID *Data
1323 )
1324 ;
1325
1326 EFI_STATUS
1327 EFIAPI
1328 PeiGetNextVariableName (
1329 IN CONST EFI_PEI_SERVICES **PeiServices,
1330 IN OUT UINTN *VariableNameSize,
1331 IN OUT CHAR16 *VariableName,
1332 IN OUT EFI_GUID *VendorGuid
1333 )
1334 ;
1335
1336 EFI_STATUS
1337 UpdateBootMode (
1338 IN CONST EFI_PEI_SERVICES **PeiServices,
1339 IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
1340 );
1341
1342 EFI_STATUS
1343 EFIAPI
1344 EndOfPeiPpiNotifyCallback (
1345 IN CONST EFI_PEI_SERVICES **PeiServices,
1346 IN EFI_PEI_NOTIFY_DESCRIPTOR *NotifyDescriptor,
1347 IN VOID *Ppi
1348 );
1349
1350 EFI_STATUS
1351 EFIAPI
1352 PeimInitializeRecovery (
1353 IN CONST EFI_PEI_SERVICES **PeiServices
1354 )
1355 ;
1356
1357 VOID
1358 CheckPowerOffNow (
1359 VOID
1360 );
1361
1362 VOID
1363 IchGpioInit (
1364 IN UINT16 PlatformType,
1365 IN SYSTEM_CONFIGURATION *SystemConfiguration
1366 );
1367
1368 EFI_STATUS
1369 PcieSecondaryBusReset (
1370 IN CONST EFI_PEI_SERVICES **PeiServices,
1371 IN UINT8 Bus,
1372 IN UINT8 Dev,
1373 IN UINT8 Fun
1374 );
1375
1376 VOID
1377 SetPlatformBootMode (
1378 IN CONST EFI_PEI_SERVICES **PeiServices,
1379 IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
1380 );
1381
1382 BOOLEAN
1383 CheckIfJumperSetForRecovery(
1384 VOID
1385 );
1386
1387 EFI_STATUS
1388 EFIAPI
1389 FindFv (
1390 IN EFI_PEI_FIND_FV_PPI *This,
1391 IN CONST EFI_PEI_SERVICES **PeiServices,
1392 IN OUT UINT8 *FvNumber,
1393 OUT EFI_FIRMWARE_VOLUME_HEADER **FVAddress
1394 );
1395
1396 BOOLEAN
1397 IsA16Inverted (
1398 );
1399
1400 EFI_STATUS
1401 EFIAPI
1402 CpuOnlyReset (
1403 IN CONST EFI_PEI_SERVICES **PeiServices
1404 );
1405
1406 EFI_STATUS
1407 EFIAPI
1408 InitLan (
1409 IN CONST EFI_PEI_SERVICES **PeiServices,
1410 IN SYSTEM_CONFIGURATION *Buffer
1411 );
1412
1413 EFI_STATUS
1414 EFIAPI
1415 Stall (
1416 IN CONST EFI_PEI_SERVICES **PeiServices,
1417 IN CONST EFI_PEI_STALL_PPI *This,
1418 IN UINTN Microseconds
1419 );
1420
1421 EFI_STATUS
1422 MultiPlatformInfoInit (
1423 IN CONST EFI_PEI_SERVICES **PeiServices,
1424 IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
1425 );
1426
1427 BOOLEAN
1428 IsRecoveryJumper (
1429 IN CONST EFI_PEI_SERVICES **PeiServices,
1430 IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
1431 );
1432
1433 EFI_STATUS
1434 CheckOsSelection (
1435 IN CONST EFI_PEI_SERVICES **PeiServices,
1436 IN SYSTEM_CONFIGURATION *SystemConfiguration
1437 );
1438
1439 EFI_STATUS
1440 PlatformInfoUpdate (
1441 IN CONST EFI_PEI_SERVICES **PeiServices,
1442 IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob,
1443 IN SYSTEM_CONFIGURATION *SystemConfiguration
1444 );
1445
1446 VOID
1447 PlatformSsaInit (
1448 IN SYSTEM_CONFIGURATION *SystemConfiguration,
1449 IN CONST EFI_PEI_SERVICES **PeiServices
1450 );
1451
1452 EFI_STATUS
1453 InitializePlatform (
1454 IN CONST EFI_PEI_SERVICES **PeiServices,
1455 IN EFI_PLATFORM_INFO_HOB *PlatformInfoHob,
1456 IN SYSTEM_CONFIGURATION *SystemConfiguration
1457 );
1458
1459 VOID
1460 MchInit (
1461 IN CONST EFI_PEI_SERVICES **PeiServices
1462 );
1463
1464
1465 EFI_STATUS
1466 EFIAPI
1467 SetPeiCacheMode (
1468 IN CONST EFI_PEI_SERVICES **PeiServices
1469 );
1470
1471 EFI_STATUS
1472 EFIAPI
1473 SetDxeCacheMode (
1474 IN CONST EFI_PEI_SERVICES **PeiServices
1475 );
1476
1477 EFI_STATUS
1478 GPIO_initialization (
1479 IN EFI_PEI_SERVICES **PeiServices,
1480 IN EFI_PEI_NOTIFY_DESCRIPTOR *NotifyDescriptor,
1481 IN VOID *SmbusPpi
1482 );
1483
1484
1485 BOOLEAN
1486 IsRtcUipAlwaysSet (
1487 IN CONST EFI_PEI_SERVICES **PeiServices
1488 );
1489
1490
1491
1492 EFI_STATUS
1493 InitPchUsb (
1494 IN CONST EFI_PEI_SERVICES **PeiServices
1495 );
1496
1497 EFI_STATUS
1498 EFIAPI
1499 PublishMemoryTypeInfo (
1500 void
1501 );
1502
1503
1504 #endif
EFI Development Kit II mirror for PVE